英伟达提出全栈协同设计 每美元智能体吞吐量最高提升30倍

AI 驱动中国 江汀 655次阅读
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英伟达11月5日发布技术解读,提出以GPU、CPU、网络、存储和软件协同设计应对大模型、长上下文与智能体带来的HBM压力,称相关方案可在每GPU HBM容量仅增约3%下,使Vera Rubin NVL72每美元智能体吞吐量最高提升30倍。

驱动中国11月6日消息,英伟达11月5日发布技术解读,提出以“全栈协同设计”破解AI内存瓶颈。英伟达称,在SemiAnalysis AgentX基准中,Vera Rubin NVL72相较GB300 NVL72的每美元智能体吞吐量最高提升30倍,而每GPU的HBM容量仅增加约3%。

英伟达表示,随着大模型参数规模、上下文长度和智能体应用快速增长,GPU显存正面临前所未有的压力,HBM供应趋紧、价格上升,在可以预见的未来仍将持续。

为破解当前AI内存瓶颈,英伟达探索引入“全栈协同设计”理念,将GPU、CPU、网络、存储和软件作为一个整体协同设计,让每一字节内存在AI工厂的各层级都产生更高价值。

在推理过程中,昂贵的HBM既要承载模型权重,也要保存KV缓存,用于记录模型理解当前请求所需的上下文。智能体工作流会在多次模型调用和工具调用间持续携带历史上下文,部分场景需处理多达300万个token;检索增强生成(RAG)还会把企业资料加入提示词,进一步推高内存占用。

英伟达将HBM比作仓库、将内存带宽比作装卸口。其称,容量再大,若数据进出速度跟不上,也会形成“内存墙”,导致新增容量无法有效转化为服务能力。因此,方案强调把数据压缩、放置在合适层级,并在需要前提前送回GPU。

在具体操作中,NVFP4低精度格式可压缩模型权重和KV缓存;在NVL72系统中,模型权重可分散至最多72颗GPU;Vera CPU的大容量LPDDR内存可为暂停的上下文提供就近缓冲;Dynamo推理软件则将不活跃上下文迁移至CMX上下文存储,并在复用前取回。RAG索引也可保留在CPU与存储侧,避免长期占用HBM。

英伟达援引SemiAnalysis AgentX基准称,在每用户每秒125 token的条件下,Vera Rubin NVL72相较GB300 NVL72的每美元智能体吞吐量最高提升30倍,而每GPU的HBM容量仅增加约3%。GB300 NVL72较H200平台在每用户每秒100 token条件下,每美元吞吐量最高提升10倍。

英伟达认为,这表明AI算力竞争的关键正从“显存多少”转向“每字节、每瓦特能产出多少有效token”。

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来源:驱动中国 · 原文链接:https://www.qudong.com/article/528718.html
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